vhdl」で検索した結果

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ベクターでの一致

TBassistant

TBassistant テストベンチ自動生成ツール(for VHDL

VHDL疑似解析システム VAGI 試用版 0.06H

VHDLの記述を解析、ドキュメント作成時に必要な支援情報を作成
このツールはVHDL記述を読み込み、階層構造や端子情報を認識・集計することでモジュールの階層構造やモジュールの端子情報等の各種情報を表示・記録できます。 また、モジュールのシンボル図をVISIOの描画マクロとして出力する事ができます。(提案と基礎データがあれば他のソフトにも対応可能) 報告書の作成や、バージョン...

TBassistant(ティービーアシスタント) 1.1

テストベンチ自動生成ツール(for VHDL)
 ティービーアシスタントは,VHDLデザインに必須のテストベンチを自動生成するツールです. 各設定項目を登録するだけですぐに使えるテストベンチが生成されます. テストベンチではTEXTIOを用いているためテストパターンは外部ファイルで自由に編集できます. また,出力結果に対して期待値照合を行う機能がテストベンチ...

VHDL HEX FILE ライブラリ 1.00

VHDL言語のシミュレーションModel-simで、4bit 未満の16進リテラル入出力ファイルをサポートするライブラリ
現状の標準ライブラリで、(1)READ に16進の入力が出来ない?(2)HWRITE と16進の出力ができるが、std_logic_vector のbit巾が、4で割り切れないとだめ。(3)ファイルで、文字リテラル。x"xxxx" の記述で読み込め無い。以上の取り扱いが、出来ません。これらをサポートするライブラ...

Strategy TimeChart STD

Strategy TimeChart STD 設計・開発・仕様化などあらゆるフェースで利用できるタイミングチャート・ベースの設計支援ツール


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