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Verilogの記述を解析、ドキュメント作成時に必要な支援情報を作成このツールはVerilog記述を読み込み、階層構造や端子情報を認識・集計することでモジュールの階層構造やモジュールの端子情報等の各種情報を表示・記録できます。 また、モジュールのシンボル図をVISIOの描画マクロとして出力する事ができます。(提案と基礎データがあれば他のソフトにも対応可能) 端子情報や、階層間参...
2007-04-08 フリーソフト /Windows/学習＆教育/科学/技術・工学
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